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dc.contributor.authorLópez Tomás, Raúl 
dc.date.accessioned2008-04-18T09:40:06Z
dc.date.available2008-04-18T09:40:06Z
dc.date.issued2008-04-18T09:40:06Z
dc.description.abstractEl objetivo global de este proyecto fin de carrera es realizar el diseño de arquitecturas hardware tipo pipeline, para el procesado de imágenes digitales. Se hará una comparativa de los algoritmos hardware implementados en estas arquitecturas frente a otros algoritmos basados en microprocesadores, algoritmos software. Estas arquitecturas hardware permiten realizar varios tipos de procesado en cascada, incrementando la velocidad de cómputo, además de descargar al microprocesador de estas tareas. El diseño de arquitecturas hardware está basado en dispositivos de lógica reconfigurable como son las FPGAs (Field Programmable Gate Arrays). Estas arquitecturas son presentadas como núcleos hardware que serán cargados sobre una FPGA. La implementación del diseño se realiza sobre una tarjeta reconfigurable compuesta por una FPGA (XC4036EX) que se comunica con un PC (HOST) a través del bus PCI. Los algoritmos software han sido implementados utilizando unas librerías específicas, para el procesado de imágenes digitales.es
dc.formatapplication/msworden
dc.language.isospaes
dc.rightsAtribución-NoComercial-SinDerivadas 3.0 España*
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/3.0/es/*
dc.titleArquitecturas pipeline para la implementación de algoritmos de visión artificiales
dc.typeinfo:eu-repo/semantics/bachelorThesises
dc.subject.otherLenguajes y Sistemas Informáticoses_ES
dc.contributor.advisorNavarro Lorente, Pedro Javier 
dc.subjectVisión artificiales
dc.subjectRobóticaes
dc.identifier.urihttp://hdl.handle.net/10317/131
dc.description.centroEscuela Técnica Superior de Ingeniería Industriales
dc.rights.accessRightsinfo:eu-repo/semantics/openAccesses


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